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【2h】

Fast cache and bus power estimation for parameterized system-on-a-chip design

机译：用于参数化片上系统设计的快速缓存和总线功率估计

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Tony D. Givargis; Frank Vahid; Jörg Henkel;
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年度 2000
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1. Evaluating power consumption of parameterized cache and busarchitectures in system-on-a-chip designs [J] . Givargis T.D., Vahid F., Henkel J. IEEE transactions on very large scale integration (VLSI) systems . 2001,第4期

机译：评估片上系统设计中的参数化缓存和总线体系结构的功耗
2. Faster power estimation of CMOS designs using vector compaction - a fractal approach [J] . Radjassamy R., Carothers J.D. IEEE transactions on systems, man, and cybernetics. Part B, Cybernetics . 2003,第3期

机译：使用矢量压缩更快地估计CMOS设计的功率-分形方法
3. Faster power estimation of CMOS designs using vector compaction - a fractal approach [J] . Radjassamy R., Carothers J.D. IEEE transactions on systems, man, and cybernetics. Part B, Cybernetics . 2003,第3期

机译：使用矢量压缩更快地估计CMOS设计的功率-分形方法
4. Fast cache and bus power estimation for parameterized system-on-a-chip design [C] . Tony D. Givargis, Frank Vahid, Jorg Henkel, Annual Workshop on Petascale Data Storage;Workshop on Petascale Data Storage . 2009

机译：用于参数化片上系统设计的快速缓存和总线功率估计
5. System-level exploration for Pareto-optimal configurations in parameterized system-on-a-chip architectures. [D] . Givargis, Tony Digaleh. 2001

机译：参数化片上系统架构中Pareto最优配置的系统级探索。
6. An Inductively Powered Scalable 32-Channel Wireless Neural Recording System-on-a-Chip for Neuroscience Applications [O] . Seung Bae Lee, Hyung-Min Lee, Mehdi Kiani, -1

机译：感应供电可扩展的32通道无线神经记录系统芯片为神经科学应用
7. Fast cache and bus power estimation for parameterized system-on-a-chip design [O] . Tony D. Givargis, Frank Vahid 2000

机译：用于参数化片上系统设计的快速高速缓存和总线功率估计
8. Fast synchronization for shared-memory multiprocessors. Synchronizing caches: Busy-wait locking, waiting, unlocking. Sleep-wait and service-request queuing: Paradigm for high-contention atomic operatiions [R] . Bitar, Philip 1985

机译：共享内存多处理器的快速同步。同步缓存：忙等待锁定，等待，解锁。睡眠等待和服务请求排队：高争用原子操作的范例

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